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摘 要:采用每級(jí)為1.5位精度的7級(jí)流水線(xiàn)結(jié)構(gòu),即7級(jí)子ADC設(shè)計(jì)一個(gè)8位80 MS/s的低功耗模數(shù)轉(zhuǎn)換電路。通過(guò)設(shè)計(jì)精簡(jiǎn)且高效的數(shù)字校準(zhǔn)和輸出寄存模塊,消除ADC實(shí)現(xiàn)過(guò)程中各種因素的影響,提高ADC的精度和信噪比。采用0.18 μm CMOS工藝完成加工后,測(cè)得該ADC在輸入信號(hào)為36.25 MHz,采樣速率為80 MHz下的信噪比(SNR)為49.6 dB,有效位數(shù)(ENOB)接近8位,典型的功耗電流只有18 mA,整個(gè)ADC的芯片面積為0.5 mm2。(剩余5334字)
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8位高速低功耗流水線(xiàn)型ADC優(yōu)化設(shè)計(jì)研究
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